三位二进制计数器VHDL编码

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查看11 | 回复1 | 2009-4-1 19:06:10 | 显示全部楼层 |阅读模式
我要的是详细的也就是全部写好的

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千问 | 2009-4-1 19:06:10 | 显示全部楼层
process(clk) beginif rising_edge(clk) then
cnt<=cnt+1;end if;end process;entity自己写吧...
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