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verilog 的testben代码 将data按位发送,但是我设置的是,每次时钟都发送一位data到uartdata,但是波形图
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2013-5-6 11:32:36
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自己做了下仿真,波形是正确的,再看你的波形,uartdata是在时钟下降沿触发,如果是做功能仿真的话,那么uartdata应该不是你代码里的那个信号。PS:例化的模块里的uartdata应该是输入吧? 你可以排除一下: 1、是否导入错误的文件或者仿真的模块不正确,可以修改一下当前文件的代码(比如data的值),再仿真看是否有改变。 2、检查一下modelsim的设置或者仿真的操作是否有问题。 如果是做时序仿真,做一下功能仿真看看是否是代码问题。...
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