Xilinx ISE 编译时,place & route 很慢.

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查看11 | 回复1 | 2012-7-30 18:46:43 | 显示全部楼层 |阅读模式
个人看法,有两种可能:1. 你的工程占用资源较多,随着资源的消耗,如果工程很大,ISE需要反复将之前布线好的部分进行优化,以腾出空间给后面的逻辑,所以越到后来布通所花费的时间就越长;2. 你的约束中有较为苛刻或是不合理的时序约束,ISE需要花大量的优化计算去满足你的约束。欢迎讨论。...
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