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关于VHDL的三个问题，我真的头大了，求高人指教。。。。

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查看11 | 回复7 | 2021-1-27 06:25:48 | 显示全部楼层 |阅读模式
1、使用VHDL采取三种不同方式设计1位全加器。（带一个仿真波形即可）
2、使用VHDL设计8选1多路选择器。
3、使用VHDL设计一个同时具有增1计数（4位）和在7段数码管上显示的控制器，即：
能对时钟信号clk计数，最高计数到F，并把计数值显示在7段数码管上。
（程序和仿真波形）
分 -->
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千问 | 2021-1-27 06:25:48 | 显示全部楼层
看书10分钟该能做这题了吧？
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千问 | 2021-1-27 06:25:48 | 显示全部楼层
随便借一本书，都会有这些例子。
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千问 | 2021-1-27 06:25:48 | 显示全部楼层



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千问 | 2021-1-27 06:25:48 | 显示全部楼层
这个很简单的哦
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千问 | 2021-1-27 06:25:48 | 显示全部楼层
引用4楼jnwsh的回复:这个很简单的哦帮帮忙。。。。VHDL不是我们的专业，我这也是帮忙。。。。
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千问 | 2021-1-27 06:25:48 | 显示全部楼层
帮帮忙噻引用4楼jnwsh的回复:这个很简单的哦
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千问 | 2021-1-27 06:25:48 | 显示全部楼层
看看书呗
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